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VESC_6.0版本开源
专业版

VESC_6.0版本开源

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简介

VESC是由Benjamin Vedder开发的一个开源无刷直流电机控制器,基于ChibiOS/RT,带有PPM信号(RC伺服),ADC,UART, I2C, USB或CAN总线接口。

简介:VESC是由Benjamin Vedder开发的一个开源无刷直流电机控制器,基于ChibiOS/RT,带有PPM信号(RC伺服),ADC,UART, I2C, USB或CAN总线接口。
复刻成本:280

开源协议

GPL 3.0

创建时间:2025-05-22 10:51:23更新时间:2025-05-22 14:31:15

描述

视频链接:

B站视频--功能演示及介绍

项目简介

VESC是由Benjamin Vedder开发的一个开源无刷直流电机控制器,基于ChibiOS/RT,带有PPM信号(RC伺服),ADC,UART, I2C, USB或CAN总线接口。原项目在6.0版本开始不再开源PCB文件,但是源代码和原理图依旧开源,本项目基于VESC官方开源的原理图绘制,对比原版有一些功能上的修改。

项目功能

具有单路FOC驱动功能,理论设计上支持72V300A相电流的最大功率输出,但是目前还没有做大电流测试。具备以下功能:
1、三路相采电路
2、支持HALL、ABI编码器、绝对式编码器等多种传感器。
3、支持多种无感算法。
4、支持PWM、IIC、ADC、UART、USB等控制方式。
对比原版缺少的功能:
1、不支持蓝牙,初步构思是使用ESP32设计一个无线下载器和蓝牙模块。
2、不支持开关机电路。因为用途是开发板,所以没画这个。
3、没有IMU传感器,感觉用不上。
4、因为ADC2、ADC3与SPI引脚冲突,保留了SPI功能,因此只有一路外部ADC输入。注:外接转把需要3.3V供电,ADC引脚不支持5V输入。

项目参数

*主控使用STM32F405RGT6
*DCDC降压芯片使用LM5164DDAR,支持6-100v宽电压输入,输出12V电压,最大1A电流。
*电流采集使用了三个0.5mΩ电阻并联,单个最大支持功率9W,使用INA240A2电流采集芯片,增益系数50V/v
*栅极驱动器使用的UCC27211AQDDARQ1,拉灌电流最大4A
*MOS管使用的NCEP15T14LL,三个MOS管并联,总共18管。

原理解析(硬件说明)

本项目由以下部分组成,主控板和功率板。主控板上有DCDC降压电路,MCU,栅极驱动电路,电流采集电路,CAN通信等等。功率板上放置了MOS管,采样电阻和三个NTC。
这里放出部分关键电路

DCDC.png

电流采样.png

mos.png

软件代码

代码使用官方开源代码即可,对应的HW配置文件和编译好的固件放在附件了,想要自己编译的同学可以根据官方教程配置好环境后,输入:

make 72_300_hp_diy

即可重新编译固件。
官方代码:VESC官方代码

注意事项

  • 因为作者不具备加载条件,所以未进行大功率测试,不保证实际功率能达到理论设计。
  • 大于36V电压输入时会产生电感啸叫声,不是很大,目前来看不影响正常工作,换个饱和电流大的电感也许可以改善,但是同封装下没有更大的选择了,所以暂时无法测试。
  • 铝基板上本来的设计是焊接贴片螺母和铜条保证过流能力的,但是偷懒了直接焊线上去。
  • 有一些元器件停产或价格较贵,可以找同样的产品替换,除了栅极驱动器和INA240电流采集芯片不建议替换,其他的都可以。
  • 立贴式的USB不方便焊接,看不到下面的引脚,这一点有点坑。
  • 想学习FOC相关知识的同学可以加群:957377627

参考&致谢

项目硬件设计过程中参考如下工程:
https://vesc-project.com/
https://oshwhub.com/lylssy/foc_driver

实物图

IMG_20250521_135806.jpg
图1.组装图

IMG_20250522_135029.jpg
图2.功率板

设计图

未生成预览图,请在编辑器重新保存一次

BOM

暂无BOM

3D模型

序号文件名称下载次数
暂无数据

附件

序号文件名称下载次数
1
72_300_HP_DIY.zip
590
克隆工程
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工程成员

知识产权声明&复刻说明

本项目为开源硬件项目,其相关的知识产权归创作者所有。创作者在本平台上传该硬件项目仅供平台用户用于学习交流及研究,不包括任何商业性使用,请勿用于商业售卖或其他盈利性的用途;如您认为本项目涉嫌侵犯了您的相关权益,请点击上方“侵权投诉”按钮,我们将按照嘉立创《侵权投诉与申诉规则》进行处理。

请在进行项目复刻时自行验证电路的可行性,并自行辨别该项目是否对您适用。您对复刻项目的任何后果负责,无论何种情况,本平台将不对您在复刻项目时,遇到的任何因开源项目电路设计问题所导致的直接、间接等损害负责。

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